我们希望你可以帮助我们：

* 定义微架构以及撰写详细的设计规范
* 编写高质量的RTL代码实现高性能的设计
* 与性能模型团队/性能分析团队一起进行芯片性能改进
* 与设计验证团队一起制定验证测试计划，覆盖率分析，芯片仿真以及调试
* 负责物理设计团队进行模块的物理综合和设计
* 和中美两地多个团队一起定义下一代的产品
* 给硅后团队提供芯片Bring-up支持
* 与软件团队一起确保产品满足客户需求

任职要求：

本科/硕士学历以上并且有5年以上ASIC设计的工作经验
* 具有过硬的Verilog/SystemVerilog RTL设计能力
* 具有微架构-资源折衷，SoC Inegration，CDC，LINT方面的经验
* 具有物理综合，时序分析，时序收敛，形式验证，可测性设计等方面的经验
* 具有网络设计经验是一个加分项，包括网络交换机，路由器和网卡
* 具有实际设计高性能网络控制芯片的经验是一个加分项，包括支持RDMA（RoCEv2或iWARP）和ToE
* 熟悉CPU，GPU，DSP或者AI加速器硬件架构
* 熟悉版本管理工具
* 熟悉脚本编程语言，譬如Perl或者Tcl

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